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#3693416

Em arquitetura de computadores, a hierarquia de memória impacta latência, largura de banda e coerência entre núcleos. Assinale a alternativa que alinha política de escrita em cache, protocolo de coerência e predição de acesso para reduzir tráfego no barramento mantendo consistência observável pelos threads.

  • Adotar write-through com write-allocate em cache exclusivo e prefetch agressivo sem controle, garantindo atualização frequente e latências estáveis em cenários com muita escrita compartilhada.
  • Utilizar write-back com write-around em cache inclusivo e protocolo MSI, priorizando invalidações amplas e prefetch estático, mantendo cópias duplicadas em todos os níveis como estratégia principal.
  • Empregar write-back com write-allocate em cache parcialmente inclusivo e protocolo MESI ou MOESI, combinando invalidação seletiva e prefetch adaptativo guiado por padrões reais de acesso.
  • Definir write-through com write-allocate em cache exclusivo e protocolo directory-based, aplicando prefetch aleatório, distribuindo pedidos de leitura de forma equitativa entre controladores.
  • Configurar write-behind com substituição FIFO em cache inclusivo e protocolo snooping simples, intensificando prefetch por bloco completo em cada falta observada.
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